本书基于当前主流的高性能CPU设计规格，全面介绍了高性能超标量CPU微架构的设计，并做出对应的分析。主要内容包括业界主流高性能处理器架构及超标量流水线背景知识（第1章）；CPU前端，包括指令提取单元、分支预测单元、指令译码单元的设计和优化，以及指令缓存的相关设计（第2、3章）；分支预测单元的原理、设计和优化，寄存器重命名与发射队列的原理和设计（第4、5章）；执行单元与浮点运算单元的设计实现（第6、7章）；访存单元与数据缓存设计（第8章）；重排序缓冲的原理及设计（第9章）；Intel P6 CPU微架构设计实例（第10章）。微架构设计对应于指令的生命周期，为读者提供直观和清晰的视角，便于读者对高性能CPU设计深入理解。

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本书可作为从事高性能CPU相关研发工作专业人员的参考书，或用作高等院校计算机及集成电路相关专业研究生和高年级本科生的教学参考用书，也可供对CPU设计感兴趣的读者阅读。

图书在版编目（CIP）数据

高性能超标量CPU：微架构剖析与设计/李东声等编著.—北京：机械工业出版社，2023.3

（“芯”科技前沿技术丛书）

ISBN 978-7-111-72460-5

Ⅰ.①高…　Ⅱ.①李…　Ⅲ.①微处理器-设计　Ⅳ.①TP332

中国国家版本馆CIP数据核字（2023）第010308号

机械工业出版社（北京市百万庄大街22号　邮政编码100037）

策划编辑：李培培　　　　　责任编辑：李培培

责任校对：郑　婕　李　婷　责任印制：张　博

中教科（保定）印刷股份有限公司印刷

2023年3月第1版第1次印刷

184mm×240mm·16.5印张·363千字

标准书号：ISBN 978-7-111-72460-5

定价：119.00元

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