VHDL开发精解与实例剖析
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第1章 概述

VHDL是一种硬件描述语言,用于描述硬件的行为和结构。与软件编程语言被翻译成机器指令不同,VHDL语言是被翻译成数字电路结构,最终在可编程逻辑器件或专用集成电路ASIC中以电路结构的形式实现程序所描述的功能。利用VHDL语言设计硬件电路需要一系列先进的EDA工具的支持,另一方面大多数EDA工具又都以硬件描述语言为主要输入方式。本章简要介绍可编程逻辑器件、EDA技术、硬件描述语言以及VHDL语言的相关知识,为之后读者开始VHDL语言的学习与程序设计实践作必要的铺垫。